現(xiàn)在華為芯片能達到幾納米的水平? 華為發(fā)布“韜定律”引領新路徑(2)

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2026-05-28 15:04:51 鳳凰網(wǎng)

現(xiàn)在華為芯片能達到幾納米的水平? 華為發(fā)布“韜定律”引領新路徑

據(jù)華為披露，過去六年該公司已基于這一路徑成功設計并量產了381款芯片。今年秋季，首款完整采用邏輯折疊技術的新麒麟手機芯片將正式發(fā)布，屆時相關性能有望大幅躍升。預計到2031年，基于“韜定律”的高端芯片，其晶體管密度將達到1.4納米制程的同等水平——而這一目標，并不需要依賴極紫外光刻機不斷推進物理制程節(jié)點即可實現(xiàn)。

現(xiàn)在華為芯片能達到幾納米的水平? 華為發(fā)布“韜定律”引領新路徑

華為發(fā)表“韜定律”至少蘊含三重深遠意義。首先，這是從“跟隨”到“定義”的范式轉換。過去幾十年，全球半導體產業(yè)始終沿著摩爾定律設定的軌道前進，領先企業(yè)定義規(guī)則，后來者只能被動跟隨。每一次制程節(jié)點的躍遷，都伴隨著對尖端設備和工藝的巨量投入，也意味著先發(fā)者累積的專利壁壘和市場優(yōu)勢愈發(fā)難以撼動。華為此次提出“韜定律”，本質上是跳出了“比拼制程節(jié)點”的傳統(tǒng)競賽，開辟了一條全新的技術演進路徑。這不僅是技術路線的創(chuàng)新，更是產業(yè)話語權的重構。

現(xiàn)在華為芯片能達到幾納米的水平? 華為發(fā)布“韜定律”引領新路徑

其次，這是破解“卡脖子”困境的系統(tǒng)性解法。近年來，外部技術封鎖持續(xù)加碼，先進制程設備、EDA軟件、高端芯片代工等關鍵環(huán)節(jié)受到嚴格限制。傳統(tǒng)路徑下，要提升芯片性能幾乎必然依賴更先進的制程，而這恰恰是被封鎖的領域?！绊w定律”的多層級協(xié)同優(yōu)化思路，提供了一種不單純依賴物理制程微縮的性能提升路徑——通過邏輯折疊、時延壓縮等技術，在現(xiàn)有制程條件下實現(xiàn)更高的等效密度。這意味著，即便在成熟制程上，中國企業(yè)也有望通過架構創(chuàng)新和系統(tǒng)優(yōu)化，設計出具有競爭力的高端芯片。這對于突破技術封鎖、實現(xiàn)半導體戰(zhàn)略自主，具有至關重要的現(xiàn)實意義。

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